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アルデックは、最新の言語標準をサポートする先進の検証手法を提供して、
お客様が、進化を続ける技術を活用しながら発展することをお約束します。

FPGA デザイン

FPGAベンダーサポートシミュレーションおよびデバッグプロジェクト・マネンジメント/統合環境グラフィカル/テキスト・デザインエントリ HTML/PDF ドキュメンテーション

プロトタイピング

スケーラブルなHES™プロトタイピングプラットフォーム HES Proto-AXIインターコネクトマルチFPGAデザインのパーティショニング ARM Cortexのサポート RTAX/RTSXプロトタイピング

ファンクショナルベリフィケーション

メトリクスドリブン検証 Universal Verification Methodology (UVM)Open Source VHDL Verification Methodology (OSVVM)Universal VHDL Verification Methodology (UVVM)VUnit Cocotb リンティング/デザイン解析 QEMUとRiviera-PROによるコ・シミュレーション非同期クロックドメイン検証

組込システム

Zynq US+ FPGAを使用したディープラーニング FPGAベースのNVMe データストレージモノのインターネット (IoT)自動車ADAS ネットワーキング Aldec 4K UltraHD イメージングソリューション PythonとPYNQ COVID-19の検出

ハードウェア・エミュレーション・ソリューション

協調エミュレーション UVMシミュレーション・アクセラレーションアクセラレーションのスケーラビリティ検証用IP SoCのパーティショニングエミュレーション・デバッギング

ハイパフォーマンス・コンピューティング（HPC）

コンピュータビジョン暗号化・セキュリティゲノムアライメント高頻度トレーディング大規模HPC 組込みHPC

DO-254 コンプライアンス

トレーサビリティ HDL コーディング基準ツール・アセスメントおよびクオリフィケーションのプロセス FPGAレベルのインターゲット・テスト HDL 詳細設計および検証 DO-254テンプレートおよびチェックリスト

特殊アプリケーション

レグレッション・マネージャ暗号化 DSPとRFの協調シミュレーション

ニュースルーム

Versal ACAPのような複雑なSoC FPGAのシミュレーションには何が必要ですか？ 2月 08 Aldec @ DAC 2023：FPGAおよびSoC向け設計検証ツールとソリューションを紹介 6月 26 Riviera-PROがAMD® Versal™ ACAPデザインのシステムシミュレーションをサポート 6月 14 航空電子機器業界で高まる TLM のニーズ 5月 18 アルデックとタレスがCertification Together International Conference 2023で共同発表 5月 01 すべてのニュースを表示

イベント

ハードウェア設計者のためのOOP 2月 26 (ウェブセミナー, Tokyo, Japan ) Maximizing Design Reliability with Advanced Linting: Uncover Hidden RTL Issues Early (EU) 3月 13 (ウェブセミナー, Online) Maximizing Design Reliability with Advanced Linting: Uncover Hidden RTL Issues Early (US) 3月 13 (ウェブセミナー, Online) Enhancing CDC Verification in Vivado with ALINT-PRO (US) 4月 10 (ウェブセミナー, Online) Enhancing CDC Verification in Vivado with ALINT-PRO (EU) 4月 10 (ウェブセミナー, Online) すべてのイベントを表示

ウェブセミナーの録画

Simplifying DO-254 Compliance for FPGA Designs – A Practical Approach Mastering SoC Design and Verification for DO-254 Compliance – Balancing Complexity and Safety (Hosted by ConsuNova) Navigating COTS-IP in DO-254 – Strategies for Safe and Efficient FPGA Design (Hosted by ConsuNova) Static and Dynamic CDC Verification of AXI4 Stream-based IPs The Development and Evolution of Verilog & SystemVerilog すべてのウェブセミナーを表示

リンク

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