A Proven EDA Solutions Provider makes all the difference.

アルデックは、最新の言語標準をサポートする先進の検証手法を提供して、
お客様が、進化を続ける技術を活用しながら発展することをお約束します。

FPGA デザイン

FPGAベンダーサポートシミュレーションおよびデバッグプロジェクト・マネンジメント/統合環境グラフィカル/テキスト・デザインエントリHTML/PDF ドキュメンテーション

プロトタイピング

スケーラブルなHES™プロトタイピングプラットフォームHES Proto-AXIインターコネクトマルチFPGAデザインのパーティショニングARM CortexのサポートRTAX/RTSXプロトタイピング

ファンクショナルベリフィケーション

メトリクスドリブン検証UVM トランザクション・デバッギングUVM, OVM, VMMOS-VVM™リンティング/デザイン解析非同期クロックドメイン検証QEMU 協調シミュレーション

要求管理

トレーサビリティチーム・ベースのメソドロジテスト管理変更の影響分析要求の取り込みドキュメントおよびレポート

ハードウェア・エミュレーション・ソリューション

協調エミュレーションUVMシミュレーション・アクセラレーションアクセラレーションのスケーラビリティ検証用IPSoCのパーティショニングエミュレーション・デバッギング

ハイパフォーマンス・コンピューティング(HPC)

コンピュータビジョン暗号化・セキュリティゲノムアライメント高頻度トレーディング大規模HPC組込みHPC

DO-254 コンプライアンス

HDL コーディング基準ツール・アセスメントおよびクオリフィケーションのプロセスFPGAレベルのインターゲット・テストHDL 詳細設計および検証DO-254テンプレートおよびチェックリスト

特殊アプリケーション

レグレッション・マネージャ暗号化DSPとRFの協調シミュレーション

組込システム

Zynq US+ FPGAを使用したディープラーニングFPGAベースのNVMe データストレージモノのインターネット (IoT)自動車ADASネットワーキングAldec 4K UltraHD イメージングソリューションPythonとPYNQCOVID-19の検出
中規模から大規模ASIC/SoCデザインのプロトタイピングおよびエミュレーションに最適な新しいHESボード 7月 19 低消費電力、高セキュリティアプリケーションをターゲットにした新しいTySOM-Mシリーズ 7月 07 アルデック、HES-DVM Proto "Cloud Edition "を発表 - FPGAベースのASICおよびSoCプロトタイピングへのアクセスを容易になります 6月 02 Riviera-PRO™により、VHDL 2019ユーザーは言語の新機能の力を解き放つことができます 5月 18 航空システム設計保証:アルデックはALINT-PROのDO-254プラグインに60以上の新しいHDLルールを追加 3月 04 すべてのニュースを表示
Using OVL for Assertion-Based Verification of Verilog and VHDL Designs (EU) 10月 21 (ウェブセミナー, Online) Using OVL for Assertion-Based Verification of Verilog and VHDL Designs (US) 10月 21 (ウェブセミナー, Online) Constraint Random Verification with Python and Cocotb (EU) 11月 04 (ウェブセミナー, Online) Constraint Random Verification with Python and Cocotb (US) 11月 04 (ウェブセミナー, Online) Design Automation Conference (DAC) 2021 12月 05 - 09 (業界イベント, San Francisco, CA) すべてのイベントを表示
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